【经验分享】KL25 16位单端ADC最高转换频率下代码效率测试及被采波形复现-融创电子社区

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[资料] 【经验分享】KL25 16位单端ADC最高转换频率下代码效率测试及被采波形复现

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楼主 | 发布于 2020-10-14 | 只看楼主

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一， KL25 16位ADC最高转换率基本知识
要将16位ADC的转换率配置为最高，首先需要选择最高的ADC模块转换时钟频率，16位ADC模块转换时钟范围可以在KL25的datasheet中查看到：

图1

如果实际的Bus时钟配置为24Mhz，那么ADC转换时钟频率fADCK要达到最高，就需要bus时钟二分频，即ADCx_CFG1[ADICLK]=(0b)01。
从用户手册中可知，ADC的转换时间公式为：
ConversionTime=SFCAdder+AverageNum*(BCT+LSTAdder+HSCAdder).
其中SFCAdder为单次或者连续采样的第一次转换时间，具体的时间可以查看如下表格：

图2

AverageNum即平均数因子，由SC3[AVGE]和SC3[AVGS]寄存器配置决定。可以通过如下表格查看具体情况：

BCT，基本转换时间，这个和选择的ADC转换位数以及单端还是差分有关，具体可以查看如下表格：

图4

LSTAdder，即长采样时间，具体可以查看如下表格：

图5

HSCAdder，即高速转换时间，具体可以查看如下表格：

图6

如果想配置ADC为16位单端的最高采样频率，则可以做如下配置：

（1）16位单端模式，bus时钟24Mhz作为输入源
（2）输入时钟二分频作为ADC的转换时钟频率fadck.
（3）长采样时间禁止
（4）高速采样使能
（5）连续采样，平均因子选择为1.
通过如上的设置可以知道，首次单端连续采样的时间=5 ADCK cycles + 5 bus clock cycles+25 ADCK cycles +2 ADCK cycles =2.875us
其余的连续采样时间=25 ADCK cycles +2 ADCK cycles=2.25us。则可以知道，以后的连续采样频率可以最高可以高达444.44khz。
下面讲一下乃奎斯特采样定理：在进行模拟/数字信号的转换过程中，当采样频率大于信号中最高频率的2倍时，采样之后的数字信号完整地保留了原始信号中的信息，一般实际应用中保证采样频率为信号最高频率的5~10倍；
所以可以知道，实际应用中，我们能够达到的信号采样频率可以高达（44Khz~88khz）。当然，随着一个周期中采样点的减少，波形肯定会变的不是很好。

二， KL25 16位ADC最高转换率软件配置
本文通过使用CW中PE里的Init_ADC模块配置，具体配置情况如下：

图7

可以看到，和计算的结果一样，16位ADC的连续转换时间可以达到2.25us，即转换频率可以达到444.44Khz,除了第一次转换之外。另外，ADC的引脚选择的是ADC0_SE8/TSI0_CH0/PTB0/LLWU_P5/I2C0_SCL/TPM1_CH0。
然后在ADC的转换完成中断中加上如下代码：
   void ADC0_Isr(void)
    {

       if (( ADC0_SC1A & ADC_SC1_COCO_MASK ) == ADC_SC1_COCO_MASK)
       {
<div style="line-height: normal; margin: 0in 0in 0pt">              if<span style="color: black; font-size: 10pt">(cnt

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