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所有模数转换器(ADC)和数模转换器(DAC)都需要一个基准信号，通常为电压基准 。 ADC的数字输出表示模拟输入相对于它的基准的比率；DAC的数字输入表示模拟输 出相对它的基准的比率。有些转换器有内部基准，有一些转换器需要外部基准。不管怎样所 有转换器都必须有一个电压(或电流)基准。
数据转换器的最早应用是用于缓慢变化信号的直流测量。在这种情况下，测 量 的精确定时并不重要。当今大多数数据转换器是应用在数据采集系统，在这种系统中必须处 理大量等间隔的模拟采样值，而且频谱信息与幅度信息同样重要，这里涉及到的采样频率或 时间基准(采样时钟或重建时钟)与电压基准一样重要。
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楼主
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回复于 2018-07-26
11#
时间基准部分
问：你为什么说系统的时钟是一种基准?
答：这个说法并不是指对模数转换器所施加的转换时钟。原则上它用于数据采集 系统的采样时钟。在这些系统中，对于存储、通信、计算分析或其它处理需要对信号按照预 定的间隔(通常是等间隔)重复采样。采样时钟的品质是系统性能的一个限制因素。
楼主
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回复于 2018-07-26
12#
问：晶体振荡器是非常稳定的，是吗?
答：晶体振荡器虽然具有很好的长期稳定性，但它经常产生短期的相位噪声。如果设计者不使用晶体振荡器而使用RC弛张振荡器(如555或4046)也会导入相位噪声。弛张振荡器有很大的相位噪声。
楼主
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回复于 2018-07-26
13#
问：怎样才能保证采样时钟具有低的相位噪声?
答：在你的微处理器或数字信号处理器中不能使用晶体振荡器电路作为采样时钟源。在晶体振荡器电路中尽可能不使用逻辑门电路。晶体振荡器通常是用逻辑门过激励晶体构成的，这不仅对长期稳定性没有好处，而且会引入比一个简单的晶体管振荡器还坏的相位噪声。另外来自处理器的数字噪声，或者从集成封装的其它门电路来的数字噪声(假设逻辑门用作振荡器)将作为相位噪声出现在振荡器输出端。
理想情况下，可使用一只晶体管或场效应管作为晶体振荡器和具有一个逻辑门的缓冲器。 这个逻辑门和振荡器本身具有去耦极好的电源。集成封装的门电路将不被采用，因为来自那里的逻辑噪声将对信号相位调制(它们可以用在直流场合，但不能用于快速开关状态)。
假如在晶体振荡器和各种模数转换器的采样时钟输入端之间有一个分频器，要使这个分 频器的电源与系统逻辑分别进行去耦，以使电源噪声避开相位调制时钟。
采样时钟电源线应远离所有的逻辑信号线以防止来自引入的相位噪声干扰。同时它还应远离 低电平模拟信号线，以免使之恶化。
楼主
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回复于 2018-07-26
14#
问：你已经告诉我不要使用处理器中的时钟振荡器作为采样的时钟源。为什么不能使用?因为这些信号之间有一个恒定的相位关系，所以两者用同一振荡器不是很合理吗?
答：确实如此，但在这种情况下使用一个独立的低噪声振荡器驱动处理器的时钟输入和经过分离缓冲的采样时钟分频器(虽然它们可封装在一起)常常是比使用处理器中的振荡器要好。在具有低采样速率中等精度的系统中使用处理器内部振荡器才有可能，但要用 图16核对。
楼主
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回复于 2018-07-26
15#
问：你已经告诉我不要使用处理器中的时钟振荡器作为采样的时钟源。为什么不能使用?因为这些信号之间有一个恒定的相位关系，所以两者用同一振荡器不是很合理吗?
答：确实如此，但在这种情况下使用一个独立的低噪声振荡器驱动处理器的时钟输入和经过分离缓冲的采样时钟分频器(虽然它们可封装在一起)常常是比使用处理器中的振荡器要好。在具有低采样速率中等精度的系统中使用处理器内部振荡器才有可能，但要用 图16核对。
图1.6示出了采样时钟的总相位抖动对信噪比或有效位数(ENOB)的影响。这个抖动有效值为t ph ，它由采样时钟振荡器相位抖动、当传输采样时钟经过系统时引入的相位抖 动和模数转换器的采样保持放大器的孔径抖动三者的平方和的平方根(rss)组成。图16的 数据可能有一些不准确，因为它用来说明仅需不太大的相位噪声便会使高分辨率采样系统 性能变坏。
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